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標(biāo)題: 誰知道 [打印本頁(yè)]

作者: jinmailang 時(shí)間: 2012-2-15 22:58
標(biāo)題: 誰知道
Verilog HDl和vhdl相比誰的優(yōu)勢(shì)大一些

作者: 我與阿Q同鄉(xiāng) 時(shí)間: 2012-2-16 18:13
Verilog

作者: asyou 時(shí)間: 2012-2-17 09:47
Verilog語法簡(jiǎn)單、明了，容易掌握！

作者: yzg 時(shí)間: 2012-2-17 21:38
Verilog在國(guó)內(nèi)用得相對(duì)多一些，而且更容易學(xué)。

作者: dingchuanpeng 時(shí)間: 2012-2-20 09:51
Verilog更好吧，簡(jiǎn)單易學(xué)，容易掌握~~~

作者: braveboys 時(shí)間: 2012-2-20 18:38
看你的公司把，不國(guó)現(xiàn)在一般公司verilog'多些

作者: diirtydog 時(shí)間: 2012-3-8 17:16
打下醬油

作者: jerryaaa 時(shí)間: 2012-4-8 21:23
看你做什么，IP CORE中兩種語言都有

作者: 鄭樹義 時(shí)間: 2012-4-8 21:51
Verilog

作者: McuPlayer 時(shí)間: 2012-4-8 22:35
Verilog和VHDL的關(guān)系，有點(diǎn)類似于C語言和Pascal語言

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