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Vivado視頻教程：靜態(tài)時序分析與約束驗證

發(fā)布時間：2014-11-26 13:52    發(fā)布者：eechina
關(guān)鍵詞： Vivado , 時序 , 約束

視頻簡介：在考慮為您的 FPGA 設(shè)計實現(xiàn)時序收斂之前，必須首先設(shè)置時序約束。不過，確定約束的正確性相當(dāng)具有挑戰(zhàn)性。在本期的 Chalk Talk 教學(xué)中，Amelia Dalton 與 Xilinx 的Ron Plyler 探討一些用來設(shè)置和驗證時序約束的功能強大的最新方法，幫您利用 Xilinx 的 Vivado 設(shè)計套件實現(xiàn)時序收斂。
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