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Verilog 編寫(xiě)的基于VGA的動(dòng)畫(huà)圖像顯示_fpga的VGA接口設(shè)計(jì)_明德?lián)P資料

發(fā)布時(shí)間:2017-8-2 15:30    發(fā)布者:mdykj33
工程說(shuō)明
本工程VGA顯示要求:復(fù)位后,屏幕中央顯示直徑為10的藍(lán)色圓點(diǎn);按下按鍵0,圓點(diǎn)圖像逐漸變大,直至直徑變?yōu)?00;再按一下按鍵0,圓點(diǎn)逐漸變小,直到直徑為10。此過(guò)程要有明顯的動(dòng)畫(huà)效果。

案例補(bǔ)充說(shuō)明
本設(shè)計(jì)的VGA圖像動(dòng)態(tài)顯示是基于FPGA實(shí)現(xiàn)的,采用了VerilogHDL語(yǔ)言編寫(xiě),再加上有明德?lián)P的至簡(jiǎn)設(shè)計(jì)法作為技術(shù)支撐,可使程序代碼簡(jiǎn)潔且執(zhí)行效率高。
代碼說(shuō)明文檔
至簡(jiǎn)設(shè)計(jì)法--VGA_顯示動(dòng)畫(huà).rar (302.95 KB)
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