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PLL鎖相環(huán)資料集錦

發(fā)布時間：2012-4-16 21:26 發(fā)布者：看門狗

關(guān)鍵詞： PLL , 鎖相環(huán)

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鎖相環(huán)PLL原理與應(yīng)用
PLL電子教案
單片有源像素傳感器中鎖相環(huán)時鐘發(fā)生器研究.kdh
基于_調(diào)制的鎖相小數(shù)頻率合成.nh
PLL鎖相環(huán)
應(yīng)用于GPS接收機頻率綜合器分頻器的設(shè)計
PLL上課講義
基于Sigma-delta調(diào)制器的小數(shù)N頻率綜合器設(shè)計
PLL原理講義
基于PLL的時鐘數(shù)據(jù)恢復(fù)電路設(shè)計.kdh
鎖相環(huán)頻合器的分頻器的設(shè)計及其環(huán)路的分析
高速分頻器研究
PLL電路設(shè)計與制作
一種全差分高速鎖相環(huán)電路的設(shè)計與實現(xiàn)
基于DDS和PLL技術(shù)的頻率合成器設(shè)計與實現(xiàn).kdh
高速低功耗CMOS分頻器實現(xiàn)
一款數(shù)字鎖相環(huán)及其分數(shù)分頻實現(xiàn)
采用PLL設(shè)計時需要注意的問題
基于_調(diào)制的小數(shù)分頻鎖相環(huán)的研究
基于MASH 2-1結(jié)構(gòu)的小數(shù)分頻鎖相環(huán)的設(shè)計與實現(xiàn)
基于注入鎖定的RF低功耗正交本振信號產(chǎn)生電路
基于MATLAB的FIR數(shù)字低通濾波器分析和設(shè)計
鎖相環(huán)型頻率綜合器中的高速分頻器
基于TSMC 0.25μm工藝的5GHz31_32雙模預(yù)分頻器的設(shè)計
高速吞脈沖程序分頻器的電路設(shè)計與 PSPICE模擬
CPLD和USB串并轉(zhuǎn)換]
基于MATLAB的FIR數(shù)字濾波器的設(shè)計與實現(xiàn)
一種先進的N分數(shù)鎖相環(huán)頻率合成器

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